STAGE : Développement d’outils d’automatisation pour validation de layout F/H

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A propos de vos missions
Le développement de nouveaux procédés de fabrication nécessite la conception de structures de test permettant de caractériser et valider les différents composants (transistors, résistances, diodes, capacités...) et les étapes de fabrication. Nous cherchons à améliorer la qualité de la validation des structures de test et à réduire significativement le temps consacré en limitant le nombre de vérifications manuelles.
Au sein du département R&D technologies, vous aurez pour mission d'automatiser les vérifications effectuées sur les structures de test à partir des logiciels Cadence. Vous partirez de cas d'études récents et des outils de DRC (design rule check) et LVS (layout vs schematic) disponibles.
Vous aurez en charge de :
- Dessiner/modifier les structures qui serviront à la validation
- Reprendre et étendre une application existante
- Coder le DRC/LVS pour des composants spécifiques
Attendus :
- Formuler les préconisations pour la conception des structures pour faciliter les vérifications
- Adapter l'application existante aux nouvelles technologies et composants
Ce stage nécessite des compétences en programmation et des connaissances dans le domaine de la micro-électronique. Une phase de formation et d'auto-formation sera nécessaire pour s'approprier l'environnement de travail et les langages de programmation spécifiques, en collaboration avec les équipes de layout et de développement du LVS.
A propos de vous
- Vous cherchez un stage de 6 mois (fin d'études) ou bien un stage de 3 mois suivi d'un contrat de professionnalisation
- Master I/II ou école d’ingénieur spécialité micro-électronique (4 eme ou 5 eme année)
- Vous pratiquez un ou plusieurs des langages suivants : TCL, Python, script csh
- Vous êtes curieux, autonome, force de proposition
- Des bases sous Linux sont un plus
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0-2 STAGE : Développement d’outils d’automatisation pour validation de layout F/H
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